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          并聯電容器裝置設計技術規程
          http://www.atozguy.com 時間:2009/3/27 14:29:16 來源:本站原創 點擊次數:15669


            第3.5.2條 本條規定是為了使電容器回路的綜合阻抗對被限制的諧波呈感 性,從而避免容性阻抗的高次諧波放大現象。電抗器的感抗值應滿足XL>(XC為電容器組的容抗),對于5次諧波則有XL>=0.04XC;對于3次諧波 XL>=0.11Xc。因此,在實際應用中,為了限制5次及以上的諧波,常選用電 抗值為5%~6%Xc的串聯電抗器,而為了限制3次及以上的諧波,常選用電抗值 為12%~13%Xc的串聯電抗器。限制涌流的電抗器可按附錄二計算。


            關于我國電力系統高次諧波管理的規定,可按水電部頒發的《電力系統諧波 管理的暫行規定》執行。


            當采用串聯電抗器后,應注意由此引起的電容器端電壓的升高。


            第3.5.3條 本條是根據電容器允許長期過電流運行的條件下,同時考慮鐵芯 電抗器的飽和作用而規定的。規定的1.35倍額定電流中包括35%的高次諧波等效 電流。


            串聯電抗器應滿足短路時的動穩定電流及短路持續時間內的熱穩定電流的要 求,且不產生任何機械的或熱的損傷。


            串聯電抗器的噪音水平,一般要求在額定電流下,距離電抗器處殼1m處, 噪音不大于70dB。

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          關鍵字:并聯電容器|裝置設計|技術規程
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